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標(biāo)簽 > ip核
IP就是知識(shí)產(chǎn)權(quán)核或知識(shí)產(chǎn)權(quán)模塊的意思,在EDA技術(shù)開發(fā)中具有十分重要的地位。美國(guó)著名的Dataquest咨詢公司將半導(dǎo)體產(chǎn)業(yè)的IP定義為“用于ASIC或FPGA中的預(yù)先設(shè)計(jì)好的電路功能模塊”。
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鋯石FPGA A4_Nano開發(fā)板視頻:內(nèi)置IP核SPI的理論原理講解
SPI是串行外設(shè)接口(Serial Peripheral Interface)的縮寫,是一種高速的,全雙工,同步的通信總線,并且在芯片的管腳上只占用四根...
一文詳解Video In to AXI4-Stream IP核
Video In to AXI4-Stream IP核用于將視頻源(帶有同步信號(hào)的時(shí)鐘并行視頻數(shù)據(jù),即同步sync或消隱blank信號(hào)或者而后者皆有)轉(zhuǎn)...
DDR3存儲(chǔ)器接口控制器IP核在視頻數(shù)據(jù)處理中的應(yīng)用
DDR3存儲(chǔ)器系統(tǒng)可以大大提升各種數(shù)據(jù)處理應(yīng)用的性能。然而,和過(guò)去幾代(DDR和DDR2)器件相比,DDR3存儲(chǔ)器器件有了一些新的要求。為了充分利用和...
USB接口IP核關(guān)鍵模塊的設(shè)計(jì)
USB通信邏輯上分成了3層:信號(hào)層、協(xié)議層和數(shù)據(jù)層。信號(hào)層用來(lái)實(shí)現(xiàn)在USB設(shè)備和主機(jī)的物理連接之間傳輸位信息流的信息。邏輯層用來(lái)實(shí)現(xiàn)在USB設(shè)備和USB...
1. XADC介紹 xadc在 所有的7系列器件上都有支持,通過(guò)將高質(zhì)量模擬模塊與可編程邏輯的靈活性相結(jié)合,可以為各種應(yīng)用打造定制的模擬接口,XADC ...
鋯石FPGA A4_Nano開發(fā)板視頻:內(nèi)置IP核SystemID的講解
System ID用來(lái)在區(qū)域內(nèi)唯一標(biāo)識(shí)主機(jī)或路由器。在設(shè)備的實(shí)現(xiàn)中,它的長(zhǎng)度固定為48bit(6字節(jié))。一般情況下,我們采用設(shè)備的router-id轉(zhuǎn)換...
FPGA中對(duì)srl16資源IP核進(jìn)行仿真
這個(gè)參數(shù)確定的是移位寄存器的移位時(shí)鐘個(gè)數(shù)。這個(gè)時(shí)鐘個(gè)數(shù)取決于后面的Depth參數(shù)。其中第一個(gè)參數(shù)Fixed Length 指的是移位周期數(shù)是固定的(后面...
鋯石FPGA A4_Nano開發(fā)板視頻:LED的IP核應(yīng)用
利用IP核設(shè)計(jì)電子系統(tǒng),引用方便,修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價(jià)值的IP核一般具有知識(shí)產(chǎn)權(quán),盡管IP核的市場(chǎng)活動(dòng)還不規(guī)范,但是仍有許多集成...
鋯石FPGA A4_Nano開發(fā)板視頻:內(nèi)置IP核USRT的應(yīng)用實(shí)戰(zhàn)講解-中斷
UART是一種通用串行數(shù)據(jù)總線,用于異步通信。該總線雙向通信,可以實(shí)現(xiàn)全雙工傳輸和接收。在嵌入式設(shè)計(jì)中,UART用于主機(jī)與輔助設(shè)備通信,如汽車音響與外接...
鋯石FPGA A4_Nano開發(fā)板視頻:DA外設(shè)IP核定制
IP核有三種不同的存在形式:HDL語(yǔ)言形式,網(wǎng)表形式、版圖形式。分別對(duì)應(yīng)我們常說(shuō)的三類IP內(nèi)核:軟核、固核和硬核。這種分類主要依據(jù)產(chǎn)品交付的方式,而這三...
FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì)
隨著可編程邏輯器件的不斷進(jìn)步和發(fā)展,F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來(lái)越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測(cè)系統(tǒng)中信號(hào)采集模塊控制器的 IP核,是采用硬...
2012-05-22 標(biāo)簽:FPGA控制器數(shù)據(jù)采集 1.8k 0
基于Nios II系統(tǒng)實(shí)現(xiàn)LCD顯示控制IP核的設(shè)計(jì)
基于NiosII 軟核的SOPC(System ON Programmable Chip)是Altera 公司提出的片上可編程系統(tǒng)解決方案,它將CPU、...
FPGA的開發(fā)流程和物理含義和實(shí)現(xiàn)目標(biāo)詳解
FPGA的開發(fā)流程是遵循著ASIC的開發(fā)流程發(fā)展的,發(fā)展到目前為止,F(xiàn)PGA的開發(fā)流程總體按照?qǐng)D1進(jìn)行,有些步驟可能由于其在當(dāng)前項(xiàng)目中的條件的寬度的允許...
在嵌入FPGA的IP核8051微處理器上實(shí)現(xiàn)UIP協(xié)議棧的設(shè)計(jì)方法
在FPGA中植入8051后, 還可在上面實(shí)現(xiàn)簡(jiǎn)單的TCP/IP協(xié)議, 以支持遠(yuǎn)程訪問(wèn)或進(jìn)行遠(yuǎn)程調(diào)試, 這只是在嵌入FPGA的8051上的一個(gè)應(yīng)用。為了保...
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