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標(biāo)簽 > ip核
IP就是知識產(chǎn)權(quán)核或知識產(chǎn)權(quán)模塊的意思,在EDA技術(shù)開發(fā)中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導(dǎo)體產(chǎn)業(yè)的IP定義為“用于ASIC或FPGA中的預(yù)先設(shè)計好的電路功能模塊”。
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基于FPGA的VHDL語言設(shè)計控制器SJA1000的IP軟核設(shè)計
分析了CAN控制器SJA1000的特點(diǎn)及CAN協(xié)議通信格式。設(shè)計了控制器SJA1000的IP軟核,能為應(yīng)用提供一個性能優(yōu)良的、易于移植的控制器SJA10...
基于多密碼算法IP核集成方法實(shí)現(xiàn)安全芯片功能多樣化
信息社會中,基于密碼算法設(shè)計的安全芯片,能夠為用戶的敏感信息提供有效的機(jī)密性與完整性保護(hù)。信息化的不斷深入使得人們對信息安全服務(wù)的需求呈現(xiàn)使用簡單化、功...
正點(diǎn)原子開拓者FPGA Qsys視頻:自定義IP核之?dāng)?shù)碼管(2)
該課程是正點(diǎn)原子團(tuán)隊編寫,詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
基于可進(jìn)化硬件EHW實(shí)現(xiàn)IP核的改進(jìn)設(shè)計
提出一種可進(jìn)化IP核的設(shè)計和實(shí)現(xiàn)方法。這種IP核采用進(jìn)化硬件的設(shè)計思想,將遺傳算法運(yùn)用于硬件電路的設(shè)計中,使電路能根據(jù)當(dāng)前的環(huán)境自動進(jìn)行內(nèi)部電路的時化,...
鋯石FPGA A4_Nano開發(fā)板視頻:內(nèi)置IP核JTAG-UART的講解
JTAG UART是要自己添加的一個IP核,通常用來是實(shí)現(xiàn)PC和Nios II系統(tǒng)間的串行通信接口,它用于字符的輸入輸出,在Nios II的開發(fā)調(diào)試過程...
隨著網(wǎng)絡(luò)技術(shù)與通信技術(shù)的高速發(fā)展,測試儀器和測試技術(shù)發(fā)生了革命性變化,“網(wǎng)絡(luò)就是儀器”確切地概括了測試儀器間的網(wǎng)絡(luò)化發(fā)展趨勢。
Distributed Memory Generator IP核簡介
Distributed Memory Generator IP 核采用 LUT RAM 資源創(chuàng)建各種不同的存儲器結(jié)構(gòu)。IP可用來創(chuàng)建只讀存儲器 (ROM...
簡介: 最近,研發(fā)人員致力于研究適用于多核設(shè)備的Linux用戶空間解決方案,該解決方案允許從用戶空間中直接訪問基礎(chǔ)硬件,從而可避免因?qū)inux內(nèi)核引入...
流水線縮短了在一個時鐘周期內(nèi)給的那個信號必須通過的通路長度,增加了數(shù)據(jù)吞吐量,從而可以提高時鐘頻率,但也導(dǎo)致了數(shù)據(jù)的延時。
認(rèn)識zedboard板子也有半個多月了,期間有不少雜事,學(xué)的也不是很認(rèn)真,最近幾天在學(xué)習(xí)如何利用AXI總線進(jìn)行PS和PL部分的相互通信,利用自定義的IP...
USB通信邏輯上分成了3層:信號層、協(xié)議層和數(shù)據(jù)層。信號層用來實(shí)現(xiàn)在USB設(shè)備和主機(jī)的物理連接之間傳輸位信息流的信息。邏輯層用來實(shí)現(xiàn)在USB設(shè)備和USB...
基于FPGA技術(shù)實(shí)現(xiàn)圖像增強(qiáng)數(shù)據(jù)的仿真實(shí)驗分析
Xilinx的Vivado中集成的圖像增強(qiáng)(Image Enhancement)IP可以有效降低圖像噪聲并增強(qiáng)圖像邊緣。該IP使用了2D濾波方式,可以在...
RAM-Based Shift Register Xilinx IP核的使用
一般來講,如果要實(shí)現(xiàn)移位寄存器的話,通常都是寫RTL用reg來構(gòu)造,比如1bit變量移位一個時鐘周期就用1個reg,也就是一個寄存器FF資源,而移位16...
FPGA之軟核演練篇:內(nèi)置IP核之Interval Timer的理論原理講解
軟核演練篇包含了哪些內(nèi)容:該篇以什么是軟核、什么是Qsys、如何構(gòu)建一個Qsys系統(tǒng)為切入點(diǎn),在該基礎(chǔ)上進(jìn)一步介紹了Nios II處理器的體系結(jié)構(gòu)、Qs...
Altera以太網(wǎng)路IP核心 降低FPGA設(shè)計難度
Altera推出40Gbit/s以太網(wǎng)路(40GbE)和100Gbit/s以太網(wǎng)路(100GbE)矽智財(IP)核心產(chǎn)品。這些核心能高效率的建構(gòu)需大傳輸...
TFT液晶顯示器(LCD)具有功耗低、體積小、工作電壓低、使用壽命長、可以顯示復(fù)雜的文字及彩色圖像等優(yōu)點(diǎn),在嵌入式設(shè)備中得到了廣泛的應(yīng)用,成為人機(jī)交互的...
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