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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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本系列將帶來FPGA的系統(tǒng)性學(xué)習(xí),從最基本的數(shù)字電路基礎(chǔ)開始,最詳細(xì)操作步驟,最直白的言語描述,手把手的“傻瓜式”講解,讓電子、信息、通信類專業(yè)學(xué)生、初...
Xilinx Vivado使用增量實(shí)現(xiàn)
增量實(shí)現(xiàn)自從首次獲得支持以來,不斷升級(jí)演變,在此過程中已添加了多項(xiàng)針對(duì)性能和編譯時(shí)間的增強(qiáng)功能。它解決了實(shí)現(xiàn)階段針對(duì)快速迭代的需求,顯著節(jié)省了編譯時(shí)間,...
簡(jiǎn)述Xilinx 7系列FPGA芯片相關(guān)知識(shí)
Xilinx 7系列芯片應(yīng)用非常廣泛,具有成本低、性能強(qiáng)悍、成熟穩(wěn)定的特點(diǎn),目前Xilinx(AMD)已延長(zhǎng)該系列芯片的生命周期至少到2035年。
基于Xilinx FPGA上實(shí)現(xiàn)深度遞歸神經(jīng)網(wǎng)絡(luò)語言模型
可編程邏輯(PLD)是由一種通用的集成電路產(chǎn)生的,邏輯功能按照用戶對(duì)器件編程來確定,用戶可以自行編程把數(shù)字系統(tǒng)集成在PLD中。經(jīng)過多年的發(fā)展,可編程邏輯...
2018-06-12 標(biāo)簽:fpga神經(jīng)網(wǎng)絡(luò)xilinx 1.7k 0
AMD-Xilinx MPSoC的Watchdog在Linux中使用的簡(jiǎn)明教程
AMD-Xilinx MPSoC的器件里,提供了內(nèi)置的Watchdog
Nexys3學(xué)習(xí)手記2:建立自己的開發(fā)環(huán)境
接過Nexys3時(shí),本以為能夠提供一張資料光盤,結(jié)果大失所望,除了靜電袋里一塊精致的電路板,就只有一條用于供電和下載的USB連接線和兩張活頁。
AMD Xilinx AXI Interrupt Controller中斷優(yōu)先級(jí)
AXI Interrupt Controller支持中斷優(yōu)先級(jí)。 在Vivado Block Design中, bit-0連接的中斷優(yōu)先級(jí)最高
Xilinx SDAccel 環(huán)境:為數(shù)據(jù)中心帶來最佳單位功耗性能
數(shù)據(jù)中心運(yùn)維人員總是不斷在尋求更高的服務(wù)器性能。目前,他們主要是通過易于編程的多核CPU 和GPU 來開發(fā)應(yīng)用,但CPU 和GPU 都遇到了單位功耗性能...
基于ZYNQ FPGA與PC的IP設(shè)計(jì)與驗(yàn)證方案(2)
賽靈思公司(Xilinx)推出的行業(yè)第一個(gè)可擴(kuò)展處理平臺(tái)Zynq系列。旨在為視頻監(jiān)視、汽車駕駛員輔助以及工廠自動(dòng)化等高端嵌入式應(yīng)用提供所需的處理與計(jì)算性能水平。
Xilinx SRL16E如何實(shí)現(xiàn)16移位寄存器
在做FPGA的開發(fā)過程中經(jīng)常會(huì)使用到移位寄存器,一般我們使用移位寄存器的目的都是為了將某個(gè)信號(hào)進(jìn)行打拍,使得時(shí)序符合我們的需求。
比特流是一個(gè)常用詞匯,用于描述包含F(xiàn)PGA完整內(nèi)部配置狀態(tài)的文件,包括布線、邏輯資源和IO設(shè)置。大多數(shù)現(xiàn)代FPGA都是基于SRAM的,包括Xilinx ...
FPGA調(diào)試設(shè)計(jì)的指導(dǎo)原則
對(duì)于FPGA調(diào)試,主要以Intel FPGA為例,在win10 Quartus ii 17.0環(huán)境下進(jìn)行仿真和調(diào)試,開發(fā)板類型EP4CE15F17。
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)(基礎(chǔ)篇)連載21:Spartan
為了更好的控制時(shí)鐘,Virtex-6器件分成若干個(gè)時(shí)鐘區(qū)域,最小器件有6個(gè)區(qū)域,最大器件有18個(gè)區(qū)域。每個(gè)時(shí)鐘區(qū)域高40個(gè)CLB。在時(shí)鐘設(shè)計(jì)中,推薦使用...
基于Xilinx Virtex-4 FPGA開發(fā)平臺(tái)驗(yàn)證并完成LCD大屏幕拼接系統(tǒng)的設(shè)計(jì)
隨著各種圖形、圖像內(nèi)容質(zhì)量的不斷提升以及系統(tǒng)運(yùn)行實(shí)時(shí)顯示的需要,金融、通信、交通、能源、安全、軍事等越來越多的行業(yè)需要建立能夠?qū)崟r(shí)整合多路信號(hào)輸入的超大...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)(基礎(chǔ)篇)連載22:Spartan
除了豐富的時(shí)鐘網(wǎng)絡(luò)以外,Xilinx還提供了強(qiáng)大的時(shí)鐘管理功能,提供更多更靈活的時(shí)鐘。Xilinx在時(shí)鐘管理上不斷改進(jìn),從Virtex-4的純數(shù)字管理單...
簡(jiǎn)單認(rèn)識(shí)現(xiàn)場(chǎng)可編程門陣列
現(xiàn)場(chǎng)可編程門陣列 (Field Programmable Gate Array, FPGA)也稱為現(xiàn)場(chǎng)可編程器件,是在 PROM ( Programma...
【ALINX 技術(shù)分享】AMD Versal AI Edge 自適應(yīng)計(jì)算加速平臺(tái)之準(zhǔn)備工作(1)
AMD Versal AI Edge 自適應(yīng)計(jì)算加速平臺(tái)之準(zhǔn)備工作,包含軟件環(huán)境、硬件環(huán)境。
100G以太網(wǎng)為8K有效負(fù)載做好準(zhǔn)備
借助最新設(shè)備,8K 超高清( 8K UHD )在專業(yè)人士和消費(fèi)者群體中正愈發(fā)普及。在此前的博客中,我們探討了身處更大規(guī)模的沉浸式媒體技術(shù)的前沿,8K 分...
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