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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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Xilinx監(jiān)控系統(tǒng)開(kāi)發(fā)人員面臨的挑戰(zhàn)
在本次網(wǎng)絡(luò)研討會(huì)中,Xilinx展示了高級(jí)監(jiān)控系統(tǒng)開(kāi)發(fā)人員面臨的關(guān)鍵挑戰(zhàn),重點(diǎn)是何時(shí)在邊緣或云端本地化實(shí)時(shí)圖像處理。
2018-11-29 標(biāo)簽:圖像處理xilinx監(jiān)控系統(tǒng) 3k 0
Vivado Xilinx FFT IP核v9.0使用說(shuō)明
一 傅里葉變換FFT 想必大家對(duì)傅里葉老人家都不陌生了,網(wǎng)上也有這方面的很多資料。通過(guò)FFT將時(shí)域信號(hào)轉(zhuǎn)換到頻域,從而對(duì)一些在時(shí)域上難以分析的信號(hào)在頻域...
如何創(chuàng)建AXI CDMA Linux用戶空間示例應(yīng)用
本篇博文將為您演示如何創(chuàng)建 AXI CDMA Linux 用戶空間示例應(yīng)用。 示例設(shè)計(jì)將在 Zynq UltraScale+ RFSoC ZCU111 ...
Versal CPM AXI Bridge模式的地址轉(zhuǎn)換
Versal 系列的 DMA axi bridge 模式可以在 PL 的 QDMA IP 或者在 CPM(The integrated block fo...
以AMD-Xilinx FPGA為例,不同的制程工藝下針對(duì)用戶的各種需求,會(huì)規(guī)劃有多個(gè)產(chǎn)品系列,其中集成不同功能、不同性能的功能模塊,因此我們按照功能模...
最近在編寫完FPGA邏輯,成功生成.bin文件后,發(fā)現(xiàn)將數(shù)據(jù)流文件燒寫到Flash時(shí)間過(guò)長(zhǎng),突然想起可以通過(guò)Vivado軟件進(jìn)行設(shè)置,提高燒寫速度。
FPGA(現(xiàn)場(chǎng)可編程門陣列)芯片是一種可編程邏輯器件,其內(nèi)部包含了大量的可編程邏輯單元和連接關(guān)系,可以通過(guò)編程來(lái)實(shí)現(xiàn)不同的邏輯功能。目前市面上有許多常見(jiàn)...
如何在設(shè)計(jì)中例化和使用多個(gè)BSCANE2模塊
本文對(duì)如何在一個(gè)工程里例化和使用多個(gè)BSCANE2模塊做一個(gè)簡(jiǎn)單說(shuō)明。
基于DS89C450的Xilinx PROM在系統(tǒng)編程設(shè)計(jì)
基于查找表技術(shù)的FPGA在應(yīng)用時(shí)需要外置一個(gè)非易失性存儲(chǔ)器來(lái)存儲(chǔ)配置數(shù)據(jù)。如何方便靈活地對(duì)一個(gè)系統(tǒng)中多片F(xiàn)PGA的配置數(shù)據(jù)進(jìn)行升級(jí)是本文討論的問(wèn)題
基于Xilinx Zynq All Programmable SoC器件實(shí)現(xiàn)的人工智能技術(shù)讓無(wú)人機(jī)更智能
人工智能現(xiàn)在是最熱門的技術(shù),已經(jīng)估值10億美元的深鑒科技在2016年的Hot Chip大會(huì)上推出了一個(gè)卷積神經(jīng)網(wǎng)絡(luò)(CNN)加速器,命名為Aristot...
基于Xilinx FPGA的抗輻射可靠性設(shè)計(jì)技術(shù)研究
空間輻射環(huán)境中的帶電粒子會(huì)導(dǎo)致航天器電子系統(tǒng)的半導(dǎo)體器件發(fā)生單粒子效應(yīng),嚴(yán)重影響航天器的可靠性和壽命,其中高能質(zhì)子和重離子是導(dǎo)致單粒子效應(yīng)的主要因素。...
如何在KV260上快速體驗(yàn)Vitsi AI圖像分類示例程序
本文首先將會(huì)對(duì)Vitis統(tǒng)一軟件平臺(tái)和Vitsi AI進(jìn)行簡(jiǎn)單介紹,然后介紹如何在KV260上部署DPU鏡像,最后在KV260 DPU鏡像上運(yùn)行Viti...
FPGA如何進(jìn)行對(duì)應(yīng)的硬件引腳分配
為PCIe IP選擇GT Quads時(shí),Xilinx建議您在最靠近PCIe硬塊的地方使用GT Quad。雖然這不是必要時(shí),它將改善設(shè)計(jì)的位置,路線和時(shí)間。
如何借助Xilinx FPGA和MATLAB技術(shù)加速機(jī)器學(xué)習(xí)應(yīng)用
本演講將結(jié)合FPGA在機(jī)器學(xué)習(xí)的發(fā)展趨勢(shì)、應(yīng)用和需求,特別介紹在基于MATLAB?完成深度學(xué)習(xí)算法設(shè)計(jì)后,F(xiàn)PGA在機(jī)器學(xué)習(xí)方面的技術(shù)優(yōu)勢(shì)和特點(diǎn),并將介...
2019-12-25 標(biāo)簽:fpgaxilinx機(jī)器學(xué)習(xí) 2.9k 0
fpga開(kāi)發(fā)板能做什么?fpga開(kāi)發(fā)板哪個(gè)好?
FPGA(現(xiàn)場(chǎng)可編程門陣列)和PLC(可編程邏輯控制器)在多個(gè)方面存在顯著的區(qū)別。
2024-03-14 標(biāo)簽:FPGAXilinx開(kāi)發(fā)板 2.9k 0
基于Xilinx的A7系列FPGA的CAN總線協(xié)議開(kāi)發(fā)
一、CAN總線協(xié)議介紹 CAN是 Controller Area Network 的縮寫(以下稱為 CAN ),是 ISO 國(guó)際標(biāo)準(zhǔn)化的串行通信協(xié)議???..
Xilinx基于ARM的Zynq-7000和Zynq UltraScale+ MPSoC及RFSoC器件是否存在安全漏洞
本文試圖搞清楚在 Xilinx 基于 ARM 的 Zynq-7000、Zynq UltraScale+ MPSoC 和 Zynq UltraScale+...
基于FPGA器件的VGA顯示設(shè)計(jì)與實(shí)現(xiàn)
中國(guó)大學(xué)MOOC 本課程以目前流行的Xilinx 7系列FPGA的開(kāi)發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVAD...
Xilinx的社區(qū)教育生態(tài)系統(tǒng)
Xilinx的社區(qū)參與企業(yè)戰(zhàn)略圍繞著教育,與非營(yíng)利組織合作,為Xilinx員工關(guān)聯(lián)和活躍的學(xué)校提供??支持。
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