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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設(shè)計工具以及作為預(yù)定義系統(tǒng)級功能的IP(Intellectual Property)核。
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各種存儲器接口控制器設(shè)計所面臨的挑戰(zhàn)和Xilinx的解決方案詳解
FPGA 設(shè)計人員在滿足關(guān)鍵時序余量的同時力爭實現(xiàn)更高性能,在這種情況下,存儲器接口的設(shè)計是一個一向構(gòu)成艱難而耗時的挑戰(zhàn)。Xilinx FPGA 提供...
FMC標(biāo)準(zhǔn)定義了單寬度(69mm*76.5mm)和雙寬度(139mm*76.5mm)兩種尺寸。單寬度模塊支持到載卡的單個連接器。雙寬度模塊主要面向需要更...
Enea OSE可實現(xiàn)對Xilinx UltraScale+ MPSoC的支持
將計算能力、可靠性和可擴(kuò)展性帶入極度苛刻的應(yīng)用 Enea近日宣布OSE5 MCE多核操作系統(tǒng)支持Xilinx? Zynq? UltraScale+?多處...
【PlanAhead教程】-7 Results Analysis and Floorplanning
教您如使用PlanAhead 13.1進(jìn)行設(shè)計應(yīng)用,通過一個設(shè)計程序,來體驗PlanAhead的功能強(qiáng)大
在zynq開發(fā)中經(jīng)常會修改設(shè)備樹,每次遇到這種情況都有點發(fā)愁,今天把設(shè)備樹相關(guān)的知識點總結(jié)一下,希望以后遇到設(shè)備樹時,能夠自如應(yīng)對。
選擇VCS,再指定庫文件存放的路徑;如果VCS的環(huán)境變量設(shè)置好了,那么會自動跳出Simulator executable path的路徑的。
本文來自AMD Xilinx實習(xí)生Shaoyi Chen及其同學(xué)Leslie Xu, 本教程將使用ZCU102開發(fā)板運行xdpdma例程,程序可以在顯示...
應(yīng)用于軟件無線電的Smarter Solution
軟件定義網(wǎng)絡(luò)是2009年左右才出現(xiàn)的新術(shù)語,被認(rèn)為是網(wǎng)絡(luò)未來的希望而備受關(guān)注,人們希望該技術(shù)能真的解決網(wǎng)絡(luò)及現(xiàn)代因特網(wǎng)時代存在的一些問題。
作者:Ricky Su,Xilinx Employee 在電影里,黑客遠(yuǎn)程控制一個城市中所有的汽車,讓它們追逐指定的目標(biāo),這樣的場景讓人感覺不寒而栗。在...
【PlanAhead教程】-5 Netlist Analysis and ChipScope Core Insertion
教您如使用PlanAhead 13.1進(jìn)行設(shè)計應(yīng)用,通過一個設(shè)計程序,來體驗PlanAhead的功能強(qiáng)大
一種基于Xilinx FPGA的部分動態(tài)可重構(gòu)技術(shù)的信號解調(diào)系統(tǒng)詳解
隨著現(xiàn)代通信技術(shù)的迅速發(fā)展,信號的調(diào)制方式向多樣化發(fā)展,解淵技術(shù)也隨之不斷向前發(fā)展。為了對高速大帶寬的信號進(jìn)行實時解調(diào),現(xiàn)在很多的解調(diào)關(guān)鍵算法都是在高速...
Xilinx Kintex UltraScale FPGA DSP開發(fā)套件主要性能和優(yōu)勢
支持JESD204B 高速模擬的 Xilinx Kintex? UltraScale? FPGA DSP 開發(fā)套件可提供一個綜合平臺,用于通過寬帶模擬數(shù)...
應(yīng)用于數(shù)據(jù)中心(DataCenter)的 Smarter Solution
使用智能手機(jī)和平板電腦時,經(jīng)常要用到云計算,也就是說計算不是發(fā)生在您所在的房間里,也不是在云端進(jìn)行,而是在數(shù)據(jù)中心完成。
ZCU10中MPSoC對DDR復(fù)位信號設(shè)計
Xilinx的開發(fā)板ZCU102支持休眠到內(nèi)存(suspend-to-ram)。休眠到內(nèi)存時,DDR進(jìn)入自刷新,MPSoC被關(guān)電,完全不耗電。喚醒時,M...
Xilinx FPGA收發(fā)器參考時鐘設(shè)計要求
FPGA收發(fā)器GTX/GTH參考時鐘接口提供兩種連接方式:LVDS(如圖1所示)和LVPECL(如圖2所示)。我們在選擇晶振時,至少要支持其中一種接口輸...
PS部分和PL部分的上電時序是獨立的,為了防止損壞器件,器件內(nèi)部已經(jīng)進(jìn)行了隔離。
基于Xilinx開發(fā)平臺和FPGA器件實現(xiàn)一維成像雷達(dá)目標(biāo)識別
目標(biāo)識別作為現(xiàn)代雷達(dá)的重要發(fā)展方向之一,成為未來武器系統(tǒng)中的一個重要組成部分和當(dāng)前國內(nèi)外關(guān)注的熱點,具有廣泛的民用和軍事應(yīng)用價值。根據(jù)雷達(dá)的探測手段及應(yīng)...
近年來,機(jī)器視覺在工業(yè)、農(nóng)業(yè)、國防、軍工、交通、醫(yī)療、金融甚至體育、娛樂等等行業(yè)都獲得了廣泛的應(yīng)用,將對我們的生活、生產(chǎn)和工作帶來革命性的改變。 據(jù)悉,...
2017-01-13 標(biāo)簽:汽車電子Xilinx意法半導(dǎo)體 3.3k 0
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