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Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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Zybo全棧開(kāi)發(fā)入門(mén)教程(基于Linux嵌入式系統(tǒng)):10個(gè)步驟自定義IP模塊
可以說(shuō)zybo是mini-zedboard。Zybo全棧開(kāi)發(fā)教程共分為三部分:自定義IP、移植Linux操作系統(tǒng)、編寫(xiě)驅(qū)動(dòng)模塊和應(yīng)用。通過(guò)這三部分你將能...
哪些SATA驅(qū)動(dòng)器支持的SATA解決方案有哪些?
各廠商的 SATA 驅(qū)動(dòng)器均能夠與 Zynq UltraScale+ MPSoC 器件的 SATA 控制器連接。 用戶需要了解以下完成測(cè)試的范圍: ...
XILINX FPGA IP之DDS Compiler_ip例化仿真
之前的文章對(duì)dds ip 的結(jié)構(gòu)、精度、參數(shù)、接口進(jìn)行了詳細(xì)的說(shuō)明,本文通過(guò)例化仿真對(duì)該IP的實(shí)際使用進(jìn)行演示。本文例化固定模式和可配置模式兩種模式分別...
Xilinx ZYNQ開(kāi)發(fā)案例HelloWorld實(shí)驗(yàn)工程
前言: 使用的板子是zc702。用Vivado的IP核搭建最小系統(tǒng),包括ARM核(CPU xc7z020),DDR3(4×256M),一個(gè)UART串口(...
Virtex-7 GTH 收發(fā)器對(duì)決 Altera Stratix V GX 收發(fā)器
Virtex-7 GTH 收發(fā)器與Altera Stratix V GX 收發(fā)器的功能對(duì)比情況
賽靈思的UltraScale架構(gòu) - 業(yè)界首款A(yù)SIC級(jí)可編程架構(gòu)
UltraScale是一款革命性創(chuàng)新型FPGA架構(gòu),用作類似于ASIC的設(shè)計(jì)方法,能幫助我們領(lǐng)先競(jìng)爭(zhēng)對(duì)手整整一代的水平。
基于Xilinx FPGA 實(shí)現(xiàn)FFT算法的電力諧波檢測(cè)的設(shè)計(jì)方案詳解
基于FFT算法的電力系統(tǒng)諧波檢測(cè)裝置,大多采用DSP芯片設(shè)計(jì)。DSP芯片是采用哈佛結(jié)構(gòu)設(shè)計(jì)的一種CPU,運(yùn)算能力很強(qiáng),速度很快;但是其順序執(zhí)行的模式限...
多用途軟件無(wú)線電系統(tǒng)的5G設(shè)計(jì)解決方案
本文旨在讓無(wú)線電工程師熟悉一種現(xiàn)成的多用途軟件無(wú)線電(COTS SDR)平臺(tái),該平臺(tái)可以縮短5G的開(kāi)發(fā)時(shí)間。 COTS SDR傳統(tǒng)上一直用于軍用雷達(dá)和通...
【PlanAhead 13.1教程】Design Preservation
教您如使用PlanAhead 13.1進(jìn)行設(shè)計(jì)應(yīng)用,通過(guò)一個(gè)設(shè)計(jì)程序,來(lái)體驗(yàn)PlanAhead的功能強(qiáng)大
在系統(tǒng)設(shè)計(jì)的初期我們不僅要考慮要實(shí)現(xiàn)的功能,性能,可操作性等方面,還有一方面便是實(shí)地的使用環(huán)境,如高溫,高濕等惡劣的條件給系統(tǒng)設(shè)計(jì)提出了新的要求
基于Xilinx System Generator設(shè)計(jì)平臺(tái)快速構(gòu)建PID算法以及完成硬件實(shí)現(xiàn)過(guò)程詳解
Xilinx System Generator 是專門(mén)為數(shù)字信號(hào)算法處理而推出的模型化設(shè)計(jì)平臺(tái),可以快速、簡(jiǎn)單地將DSP系統(tǒng)的抽象算法轉(zhuǎn)換成可綜合的、...
Fanout,即扇出,指模塊直接調(diào)用的下級(jí)模塊的個(gè)數(shù),如果這個(gè)數(shù)值過(guò)大的話,在FPGA直接表現(xiàn)為net delay較大,不利于時(shí)序收斂。因此,在寫(xiě)代碼時(shí)...
對(duì)于AMD Xilinx而言,Vivado 2019.1之前(包括),HLS工具叫Vivado HLS,之后為了統(tǒng)一將HLS集成到Vitis里了,集成之...
用Virtex-7 HT器件 四步 完成CFP2光學(xué)模塊初始化
整個(gè)行業(yè)都在力求降低功耗和材料清單成本,同時(shí)增大典型面板上的可用光通量,這可通過(guò)使用尺寸更小速度更快的小型可插拔100G CFP2光學(xué)模塊來(lái)實(shí)現(xiàn)。
Xilinx ZYNQ UltraScale+系列產(chǎn)品介紹
Zynq UltraScale+MPSoC是Xilinx推出的第二代多處理SoC系統(tǒng),它在第一代Zynq-7000的基礎(chǔ)上進(jìn)行了全面升級(jí)。
Xilinx DPD 解決方案使用經(jīng)驗(yàn)(七)
這篇文章是關(guān)于Xilinx DPD最后一篇總結(jié)文章,內(nèi)容涉及的比較寬泛,但在使用的是要注意的問(wèn)題。
數(shù)字設(shè)計(jì)FPGA應(yīng)用:7系列FPGA IOB
本課程以目前流行的Xilinx 7系列FPGA的開(kāi)發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用,并循序漸進(jìn)...
ZING SoM——業(yè)界最小Zynq系統(tǒng)開(kāi)發(fā)模塊演示
Zynq-7000 ZING SOM開(kāi)發(fā)模塊演示
Xilinx提供的手冊(cè)《ug1144-petalinux-tools-reference-guide_chn》,該文檔有說(shuō)明petalinux版本支持的...
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