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本文采用VHDL語言設(shè)計了基于CPLD的計數(shù)及LED譯碼電路，該設(shè)計方法符合電子系統(tǒng)設(shè)計的發(fā)展方向。
關(guān)鍵詞：計數(shù)器;LED譯碼;CPLD;VHDL
在各種檢測與控制系統(tǒng)及儀表中，對發(fā)生的事件進行計數(shù)并將計數(shù)結(jié)果輸出至LED進行顯示的電路用得非常廣泛,常用的設(shè)計方法有：（1）通過BCD加法計數(shù)器及BCD7段鎖存/譯碼/驅(qū)動等芯片連接而成；（2）通過單片機來實現(xiàn)。這兩種方法各有千秋，但都存在著一個共同的問題：由于電路所用芯片較多，因此電路結(jié)構(gòu)比較復(fù)雜、體積大、可靠性差。
隨著超大規(guī)模集成電路的集成度和工藝水平的不斷提高，專用集成電路ASIC的設(shè)計成本在不斷降低，在功能上，現(xiàn)代的集成電路已能實現(xiàn)單片電子系統(tǒng)SoC。CPLD/FPGA是實現(xiàn)ASIC的主流器件，它們的特點是直接面向用戶，具有極大的靈活性和通用性，使用方便、開發(fā)效率高、成本低、工作可靠性好等，正越來越受到電子工程師們的青睞，本文就用CPLD來設(shè)計計數(shù)及LED譯碼電路。
關(guān)鍵詞：計數(shù)器;LED譯碼;CPLD;VHDL
在各種檢測與控制系統(tǒng)及儀表中，對發(fā)生的事件進行計數(shù)并將計數(shù)結(jié)果輸出至LED進行顯示的電路用得非常廣泛,常用的設(shè)計方法有：（1）通過BCD加法計數(shù)器及BCD7段鎖存/譯碼/驅(qū)動等芯片連接而成；（2）通過單片機來實現(xiàn)。這兩種方法各有千秋，但都存在著一個共同的問題：由于電路所用芯片較多，因此電路結(jié)構(gòu)比較復(fù)雜、體積大、可靠性差。
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