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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>CPLD/FPGA的半整數(shù)分頻器設(shè)計

      CPLD/FPGA的半整數(shù)分頻器設(shè)計

      2021-03-16 | rar | 0.41 MB | 次下載 | 免費

      資料介紹

      　　簡要介紹了CPLD/FPGA器件的特點和應(yīng)用范圍，并以分頻比為2.5和1.5的分頻器的設(shè)計為例，介紹了在MaxPlusII開發(fā)軟件下，利用VHDL硬件描述語言以及原理圖的輸入方式來設(shè)計數(shù)字邏輯電路的過程和方法。該設(shè)計具有結(jié)構(gòu)簡單、實現(xiàn)方便、便于系統(tǒng)升級的特點。

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