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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>VHDL語(yǔ)言描述數(shù)字系統(tǒng)

      VHDL語(yǔ)言描述數(shù)字系統(tǒng)

      2009-09-01 | rar | 445 | 次下載 | 5積分

      資料介紹

      VHDL語(yǔ)言描述數(shù)字系統(tǒng):本章介紹用 VHDL 描述硬件電路的一些基本手段和基本方法。
      ?? VHDL 語(yǔ)言是美國(guó)國(guó)防部在 20 世紀(jì) 80 年代初為實(shí)現(xiàn)其高速集成電路計(jì)劃（VHSIC）而提出的一種 HDL，其含義為超高速集成電路硬件描述語(yǔ)言。
      ??? VHDL 語(yǔ)言的基本結(jié)構(gòu)是對(duì)任何電路在用 VHDL語(yǔ)言描述時(shí)，都應(yīng)有兩部分組成：實(shí)體和結(jié)構(gòu)體。實(shí)體描述電路的輸入、輸出關(guān)系；結(jié)構(gòu)體描述電路的功能。
      VHDL 語(yǔ)言描述與邏輯電路圖的對(duì)應(yīng)關(guān)系
      實(shí)體描述:實(shí)體在電路中主要是說(shuō)明該電路的輸入、輸出關(guān)系，更具體地說(shuō)就是用來(lái)定義實(shí)體與外部的連接關(guān)系以及需傳送給實(shí)體的參數(shù)。
      實(shí)體描述的一般格式為
      ENTITY???? 實(shí)體名??? IS
      ?????? [? GENERIC??? （類屬表說(shuō)明）；]
      ?????? [?? PORT???????? （端口表說(shuō)明）；]
      END [ENTITY][實(shí)體名]
      注意：[ ] 中的部分為可缺省內(nèi)容
      （1）類屬表說(shuō)明用以將信息參數(shù)傳遞到實(shí)體。最常用的信息是器件的上升沿到下降沿的延遲時(shí)間、負(fù)載電容和電阻、驅(qū)動(dòng)能力以及功耗等。
      （2）端口表指明實(shí)體的輸入、輸出信號(hào)及其模式。端口模式共有五種，如下所示。
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