先從運行一個創(chuàng)建一個項目開始吧。
首先打開Vivado設計套件Vivado HLS 2015.4;

輸入項目的名稱和存放的位置;

點擊下一步,輸入設計頂層函數(shù)的名稱,接著下一步;

暫時不需要填寫,直接下一步;

解決方案的名字默認 (solution1)就好, 時鐘周期根據(jù)需要自己設,這里我設(10 ns), 時鐘的不確定性一般為12.5%,接著選擇器件,最后“finish”。

將該例程的設計文件和testbench全部復制到剛才創(chuàng)建的項目目錄下:

在設計資源窗口右擊“Source”,添加設計文件;

再接著右擊“Test Bench”,添加文件;

至此,項目建設完成。接著進行綜合仿真,驗證設計。 點擊“Run C Snthry”。


點擊“Run C Simulation”,接著點擊“OK”;


至此,此項目在沒有硬件調(diào)試的前提下算是成功運行了。
審核編輯:湯梓紅
-
HDL
+關注
關注
8文章
330瀏覽量
48726 -
模型
+關注
關注
1文章
3626瀏覽量
51602 -
Vivado
+關注
關注
19文章
844瀏覽量
70358
發(fā)布評論請先 登錄
vcs和vivado聯(lián)合仿真
如何在vivadoHLS中使用.TLite模型
干貨分享 | TSMaster MBD模塊全解析:從模型搭建到自動化測試的完整實踐
如何在Unified IDE中創(chuàng)建視覺庫HLS組件
使用AMD Vitis Unified IDE創(chuàng)建HLS組件
如何使用AMD Vitis HLS創(chuàng)建HLS IP
從FA模型切換到Stage模型時:module的切換說明
如何使用One Spin檢查AMD Vivado Design Suite Synth的結果
Vivado HLS設計流程
FPGA Verilog HDL語法之編譯預處理
一文詳解Verilog HDL
從Level1 Model到Level3 Modle來感受器件模型是如何開發(fā)的

Vivado HLS從HDL到模型和C的描述
評論