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      標簽　>　verilog

      verilog

      +關(guān)注30人關(guān)注

      Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

      文章：711個 瀏覽：113940次 帖子：943個

      verilog技術(shù)

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      2021-08-17 標簽：振蕩器Verilog阻塞 6.9k 0

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      筆試時也很常見。 ［例1］ 一個簡單的狀態(tài)機設(shè)計－－序列檢測器 序列檢測器是時序數(shù)字電路設(shè)計中經(jīng)典的教學(xué)范例，下面我們將用Verilog HDL語言來描...

      2021-08-10 標簽：VerilogHDL讀寫器 7.6k 0

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      　verilog實現(xiàn)加法器，從底層的門級電路級到行為級，本文對其做出了相應(yīng)的闡述。

      2021-02-18 標簽：Verilog加法器 6.9k 0

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      本文檔的主要內(nèi)容詳細介紹的是FPGA的入門基礎(chǔ)知識詳細說明。

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      2020-11-26 標簽：以太網(wǎng)交換機Verilog 2.7k 0

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      2020-11-26 標簽：存儲器Verilog 4.1k 0

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      2020-11-20 標簽：fpgaVerilog模擬信號 6.1k 0

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      2020-11-19 標簽：fpgaasicVerilog 4.1k 0

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      Wire主要起信號間連接作用，用以構(gòu)成信號的傳遞或者形成組合邏輯。因為沒有時序限定，wire的賦值語句通常和其他block語句并行執(zhí)行。

      2020-11-13 標簽：寄存器Verilog編程語言 1.1萬 0

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      2020-09-01 標簽：fpgaVerilog 4.2k 0

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      本文主要闡述了verilog中端口的三種類型及verilog語言入門教程。

      2020-08-27 標簽：Verilog端口 1.2萬 0

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      首先我們不開始講Verilog HDL的語法，我們從Verilog HDL的程序結(jié)構(gòu)出發(fā)。相信大家都看過芯片吧，它有個名字，有個外殼，外殼向外伸出有引腳...

      2020-08-27 標簽：VerilogVerilog HDL 2.8k 0

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      今天給大家分享一個VHDL和Verilog的工具。很多新手初次學(xué)習(xí)FPGA都曾遇到過一個問題：是學(xué)Verilog OR VHDL？

      2020-08-25 標簽：Verilogvhdl 7.4k 0

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      • Protues
        Protues
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        Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機及外圍器件。
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        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
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        FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。
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        +關(guān)注
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        PCB封裝
        +關(guān)注
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        +關(guān)注
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        +關(guān)注
        面包板是由于板子上有很多小插孔，專為電子電路的無焊接實驗設(shè)計制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
      • candence
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        +關(guān)注
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        AXI
        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
      • 特性阻抗
        特性阻抗
        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • 時鐘源
        時鐘源
        +關(guān)注
        時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英 晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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        AD采樣
        +關(guān)注
        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
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