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PCI-Express（peripheral component interconnect express）是一種高速串行計(jì)算機(jī)擴(kuò)展總線標(biāo)準(zhǔn)，它原來的名稱為“3GIO”，是由英特爾在2001年提出的，旨在替代舊的PCI，PCI-X和AGP總線標(biāo)準(zhǔn)。

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pcie技術(shù)

采用Flow Control機(jī)制的PCIe總線

PCIe總線為了解決這一問題，提出了Flow Control的概念，如下圖所示。PCIe總線中要求接收方必須經(jīng)常（在特定時(shí)間）向發(fā)送方報(bào)告其VC Buf...

2018-04-26 標(biāo)簽：總線 PCIe 6.7k 0

FPGA PCIe加速卡開源硬件及例程介紹

基于Xilinx Artix-7系列FPGA芯片設(shè)計(jì)的M.2 M-Key FPGA加速卡，引出Artix7-484腳芯片的4條高速GT，最高支持PCIE...

2023-03-24 標(biāo)簽：HDMI SFP PCIe 6.7k 0

物理層邏輯知識(shí)，關(guān)于擾碼器需要遵循的規(guī)則

前面的文章中提到過Ordered Sets，其主要用于鏈路訓(xùn)練等。每一個(gè)Ordered Set都是按照DW對(duì)齊的（即四個(gè)字節(jié)），且Ordered Set...

2018-06-01 標(biāo)簽：PCIe 物理層 6.6k 0

基于FPGA的PCIE通信測(cè)試

本文介紹一個(gè)FPGA開源項(xiàng)目：PCIE通信。該工程圍繞Vivado軟件中提供的PCIE通信IP核XDMA IP建立。Xilinx提供了XDMA的開源驅(qū)動(dòng)...

2023-09-04 標(biāo)簽：fpga Linux WINDOWS 6.6k 0

CvP系統(tǒng)結(jié)構(gòu)解析 PCIE協(xié)議實(shí)現(xiàn)FPGA 配置案例

1. CvP 簡介 CvP（Configuration via Protocol）是一種通過協(xié)議實(shí)現(xiàn) FPGA 配置的方案，Arria V，Cyclon...

2020-11-27 標(biāo)簽：fpga PCIe 6.5k 0

xilinx sp605 PCIe EDK使用方法（之一：EDK設(shè)置部分）視頻教程

在EDK環(huán)境中針對(duì)在xilinx sp605 PCIe開發(fā)板，舉一個(gè)簡單的例子，介紹如何使用PCIE核與PC進(jìn)行數(shù)據(jù)通訊。

2018-06-07 標(biāo)簽：fpga Xilinx PCIe 6.5k 0

PCIe引腳PRSNT與熱插拔

熱插拔的基本目的是要讓PCIe設(shè)備按照規(guī)定的順序、原則，從系統(tǒng)中移除或插入到系統(tǒng)中來，并能正常的工作，且不影響系統(tǒng)的正常運(yùn)行。事實(shí)上，PCIe“熱插拔”...

2022-12-14 標(biāo)簽：熱插拔 PCIe 6.1k 0

一個(gè)簡化的PCIe總線體系結(jié)構(gòu)

一個(gè)簡化的PCIe總線體系結(jié)構(gòu)如上圖所示，其中Device Core and interface to Transaction Layer就是我們常說的...

2018-04-21 標(biāo)簽：總線 PCIe 數(shù)據(jù)鏈路層 6.1k 0

如何為KCU105評(píng)估套件創(chuàng)建Tandem設(shè)計(jì)

了解如何針對(duì)KCU105評(píng)估套件創(chuàng)建Tandem設(shè)計(jì)。 Tandem方法將比特流分成兩部分，允許首先加載比特流的PCIe部分，以確保在系統(tǒng)期間枚舉PCIe塊

2018-11-22 標(biāo)簽：asic 賽靈思 pcie 6.1k 0

進(jìn)一步提升PCIe總線通信速度的方法

隨著大數(shù)據(jù)中心、云計(jì)算服務(wù)的不斷增長，對(duì)于系統(tǒng)性能、功能和帶寬的要求也是越來越高，同時(shí)也驅(qū)動(dòng)通信總線技術(shù)不斷取得新的進(jìn)步。由英特爾提出的第三代高性能I/...

2018-06-30 標(biāo)簽：通信 pcie 6.1k 0

一文解析Nvlink的誕生和技術(shù)演進(jìn)歷程

Nvlink-C2C是個(gè)錯(cuò)誤的技術(shù)路徑。我仿佛記得Nvlink-C2C的主架構(gòu)師Wei wei是我大學(xué)同學(xué) ？有這么個(gè)模糊印象。如果單純從技術(shù)的角度...

2023-07-03 標(biāo)簽：cpu gpu 總線 6k 0

PCIe當(dāng)今的發(fā)展?fàn)顩r如何？

由簡要檢查可知，12KHz 和 20MHz 間的“通頻帶”內(nèi)無衰減，如 0dBc 的水平線所示。12KHz 和 20MHz 處的垂直線完全衰減了通頻帶外...

2018-08-30 標(biāo)簽：濾波器 PCIe 6k 0

PCIe 5.0已準(zhǔn)備好進(jìn)入黃金時(shí)段

PCI-SIG 組織期望這兩個(gè)標(biāo)準(zhǔn)在市場(chǎng)上共存一段時(shí)間，PCIe 5.0主要用于渴望達(dá)到最高吞吐量的高性能設(shè)備，如用于AI工作負(fù)載的GPU和網(wǎng)絡(luò)應(yīng)用。這...

2019-01-22 標(biāo)簽：amd 芯片組 PCIe 6k 0

在Vivado設(shè)計(jì)套件中進(jìn)行PCIe遠(yuǎn)程調(diào)試有哪些好處

本視頻將從您介紹在Vivado設(shè)計(jì)套件中通過PCIe進(jìn)行遠(yuǎn)程調(diào)試的好處。視頻詳細(xì)解釋了在所有的硬件組件和軟件組件，以及將XVC（Xilinx虛擬電纜）功...

2018-11-22 標(biāo)簽：賽靈思調(diào)試 pcie 5.9k 0

PCIe Gen5 Card金手指仿真與設(shè)計(jì)(下)

接上文提到有沒有更簡便的方法可以不做那么復(fù)雜的彎針模型呢？模型建立越接近真實(shí)情況固然越準(zhǔn)確，但是耗費(fèi)時(shí)間，準(zhǔn)確和效率找到平衡才是智者所為。

2023-12-12 標(biāo)簽：PCIe 諧振模型 5.9k 0

聊聊PCIe設(shè)備在系統(tǒng)如何發(fā)現(xiàn)與訪問？

硬盤是大家都很熟悉的設(shè)備，一路走來，從HDD到SSD，從SATA到NVMe，作為NVMe SSD的前端接口，PCIe再次進(jìn)入我們的視野。作為x86體系關(guān)...

2022-12-09 標(biāo)簽：SSD PCIe nvme 5.8k 0

PCIe 6.0入門之事務(wù)層報(bào)文格式

事務(wù)描述符是一種在請(qǐng)求方和完成方之間攜帶事務(wù)信息的機(jī)制。通過事務(wù)描述符TL層才知道要如何處理這些報(bào)文。在整個(gè)事務(wù)描述符由三個(gè)字段組成：

2023-05-22 標(biāo)簽：存儲(chǔ)器 PCIe TL 5.8k 0

PCI總線信號(hào)及功能說明

PCIe總線是繼承了PCI總線而設(shè)計(jì)而來的，理解PCIe總線先從學(xué)習(xí)PCI的知識(shí)切入。PCI(Peripheral ComponentInterconn...

2022-09-08 標(biāo)簽：存儲(chǔ)器 PCI 總線 5.8k 0

如何創(chuàng)建具有DMA和DDR3內(nèi)存支持的先進(jìn)PCIe，千兆以太網(wǎng)設(shè)計(jì)

了解連接域特定目標(biāo)設(shè)計(jì)平臺(tái)如何使您能夠創(chuàng)建具有DMA和DDR3內(nèi)存支持的先進(jìn)PCIe，千兆以太網(wǎng)設(shè)計(jì)。

2018-11-28 標(biāo)簽：以太網(wǎng)賽靈思 pcie 5.8k 0

PCIe 6.0入門之事務(wù)層

作為協(xié)議的最高層，事務(wù)層的主要功能是： ? 流水線式完整拆分交易協(xié)議 ? 區(qū)分事務(wù)層數(shù)據(jù)包 (TLP) 的排序和處理要求的機(jī)制 ? 基...

2023-05-22 標(biāo)簽：PCIe 數(shù)據(jù)包 TLP 5.8k 0

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Protues

Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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