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ASIC是Application Specific Integrated Circuit的英文縮寫(xiě)，在集成電路界被認(rèn)為是一種為專(zhuān)門(mén)目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫(xiě)，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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7 FPGA原型設(shè)計(jì)系統(tǒng)，支持達(dá)28800萬(wàn)個(gè)ASIC門(mén)的容量

Aldec? 的 ?HES-7 (HES7XV12000BP)? 在 ?FLG1925? 封裝中包含 ?6? 個(gè) ?Xilinx Virtex-7 20...

2017-02-09 標(biāo)簽：asic 467 0

MathWorks引入像素流處理算法，針對(duì)在FPGA和 ASIC上進(jìn)行視覺(jué)系統(tǒng)設(shè)計(jì)和實(shí)現(xiàn)

新的 Vision HDL Toolbox 縮短了從概念到設(shè)計(jì)的周期，并能在開(kāi)發(fā)流程早期發(fā)現(xiàn)設(shè)計(jì)錯(cuò)誤 MathWorks今日宣布引入 Vision HD...

2017-02-09 標(biāo)簽：asic 371 0

VadaTech重磅推出 New Virtex UltraScale FPGA Carrier

AdvancedMC標(biāo)準(zhǔn)定義了一種可以用于各種各樣用途的夾層卡，也叫做高級(jí)夾層卡，更通俗一點(diǎn)即AMC卡。這項(xiàng)技術(shù)最初只是作為AdvancedTCA接口標(biāo)...

2017-01-13 標(biāo)簽：fpga asic 1.3k 0

Amazon聯(lián)手Xilinx搞了件大事!!!!

在今年11月中旬舉辦的“2016年超算大會(huì)上”，F(xiàn)PGA大廠Xilinx發(fā)布了可重配置加速棧（ReconfigurableAcceleration St...

2017-01-13 標(biāo)簽：fpga asic 1.6k 0

Technavio：選出了全球 Top 6 的深度學(xué)習(xí)機(jī)構(gòu)，規(guī)模將超13億美元

Technavio 是一家全球技術(shù)研究與咨詢(xún)公司，其最近的《全球深度學(xué)習(xí)系統(tǒng)市場(chǎng)報(bào)告》選出了全球 Top 6 的深度學(xué)習(xí)機(jī)構(gòu)，分別是谷歌的母公司 Alp...

2017-01-13 標(biāo)簽：fpga asic 1.8k 0

定點(diǎn)數(shù)在CNN網(wǎng)絡(luò)應(yīng)用，同等精度下性能提高了數(shù)倍

今年3月，谷歌AlphaGo橫空出世，并打敗了韓國(guó)棋手李世石，使得深度學(xué)習(xí)乃至機(jī)器學(xué)習(xí)等領(lǐng)域不但在學(xué)術(shù)領(lǐng)域火得一塌糊涂，在普通大眾中也掀起了一番熱潮。人...

2017-01-13 標(biāo)簽：fpga asic 2.6k 0

Xilinx FPGA將用于最新亞馬遜EC2 F1實(shí)例

亞馬遜 EC2 F1實(shí)例采用了賽靈思最新 16nm UltraScale+ FPGA 賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）...

2017-01-13 標(biāo)簽：fpga asic 1.7k 1

Xilinx為器件添加二維碼標(biāo)記

想必大家對(duì)二維碼都已經(jīng)非常熟悉了，在我們的日常生活中處處都能和二維碼打交道，隨著智能手機(jī)的普及，我們可以?huà)呙瓒S碼完成收款/付款交易、查看商品或者商家信...

2017-01-13 標(biāo)簽：fpga asic Xilinx 7.9k 0

全新 Virtex UltraScale+ FPGA 評(píng)估套件加速高帶寬應(yīng)用

Virtex? UltraScale+? FPGA VCU118 評(píng)估套件采用可在 FinFET 節(jié)點(diǎn)提供最高性能及各種集成功能的 Virtex Ult...

2017-01-13 標(biāo)簽：fpga asic 3.4k 0

創(chuàng)圖像分類(lèi)速度新高： Xilinx Kintex UltraScale FPGA + xDNN Library + AlexNet + Caffe

神經(jīng)網(wǎng)絡(luò)起源于上世紀(jì)五六十年代，當(dāng)時(shí)還叫感知機(jī)，分為輸入層、隱含層和輸出層。輸入的特征向量通過(guò)隱含層變換達(dá)到輸出層，在輸出層得到分類(lèi)結(jié)果。早期的感知機(jī)只...

2017-01-13 標(biāo)簽：fpga asic Xilinx 3.7k 0

SDSoC 開(kāi)發(fā)環(huán)境 2016.3 現(xiàn)已推出！60 天評(píng)估 License 免費(fèi)下載

SDSoC? 開(kāi)發(fā)環(huán)境可為異構(gòu) Zynq? All Programmable SoC 及 MPSoC 部署提供類(lèi)似嵌入式 C/C++/OpenCL 應(yīng)用...

2017-01-13 標(biāo)簽：fpga asic Xilinx 2.3k 0

好消息！Balser公司板級(jí)嵌入式視覺(jué)應(yīng)用開(kāi)發(fā)套件上市了！

嵌入式視覺(jué)是指一種通過(guò)視覺(jué)方法去理解周邊環(huán)境的機(jī)器，在嵌入式系統(tǒng)中使用計(jì)算機(jī)視覺(jué)技術(shù)。嵌入式視覺(jué)涉及到兩種技術(shù)：嵌入式系統(tǒng)和計(jì)算機(jī)視覺(jué)（有時(shí)也稱(chēng)為機(jī)器視...

2017-01-13 標(biāo)簽：fpga asic Xilinx 1.3k 0

Avnet發(fā)布物聯(lián)網(wǎng)安全插件讓安全成為一種習(xí)慣

在與工業(yè)物聯(lián)網(wǎng)領(lǐng)域的專(zhuān)家交談中，人們無(wú)疑會(huì)聽(tīng)到他們對(duì)安全問(wèn)題的擔(dān)憂(yōu)。網(wǎng)絡(luò)黑客在互聯(lián)網(wǎng)乃至物聯(lián)網(wǎng)時(shí)代非常猖獗，經(jīng)常能聽(tīng)到網(wǎng)絡(luò)安全相關(guān)新聞。就在最近的感恩節(jié)...

2017-01-13 標(biāo)簽：fpga asic Xilinx 1.3k 0

MATLAB基于FPGA和ASIC的數(shù)字收發(fā)器的開(kāi)發(fā)

無(wú)線(xiàn)RF接收器在許多應(yīng)用中都會(huì)用到，包括無(wú)線(xiàn)安全系統(tǒng)、工業(yè)監(jiān)控、儀表讀數(shù)和家庭自動(dòng)化等等。過(guò)去，半導(dǎo)體供應(yīng)商主要使用模擬設(shè)計(jì)來(lái)構(gòu)建這些接收器。如今，供應(yīng)...

2017-01-13 標(biāo)簽：fpga asic Xilinx 688 0

【圖文】賽靈思5年轉(zhuǎn)型見(jiàn)成效，F(xiàn)PGA成超級(jí)數(shù)據(jù)中心主流應(yīng)用

彼得·蒂爾在其大名鼎鼎的《從0到1》中曾經(jīng)說(shuō)過(guò)：對(duì)未來(lái)明確的樂(lè)觀可以讓你創(chuàng)造出想要的未來(lái)，而對(duì)未來(lái)明確的悲觀則讓人走入山寨。對(duì)于引領(lǐng)全球FPGA發(fā)展的賽...

2017-01-13 標(biāo)簽：fpga asic 賽靈思 1.9k 0

QuickPlay迅速構(gòu)建基于 FPGA 的高效應(yīng)用

QuickPlay 的高級(jí)工作流程讓軟件開(kāi)發(fā)人員迅速構(gòu)建基于 FPGA 的高效應(yīng)用。隨著物聯(lián)網(wǎng)和大數(shù)據(jù)處理的崛起，人們對(duì)數(shù)據(jù)傳輸和處理的需求急劇增長(zhǎng)，...

2017-01-13 標(biāo)簽：fpga asic 689 0

用C 語(yǔ)言描述AES256 加密算法

作者：Adam Taylor 首席工程師 e2v 公司 aptaylor@theiet.org 用C 語(yǔ)言描述AES256 加密算法，然后在硬件中加速性...

2017-01-13 標(biāo)簽：fpga asic 2.7k 0

使用SDNet開(kāi)發(fā)創(chuàng)新型可編程網(wǎng)絡(luò)

日本電報(bào)電話(huà)公司 (NTT) 是一家全球電信集團(tuán)控股公司，負(fù)責(zé)制定管理策略和推動(dòng)研發(fā)工作發(fā)展。我們是 NTT 研發(fā)部的研究人員，正領(lǐng)導(dǎo)兩個(gè)針對(duì)軟件定義...

2017-01-13 標(biāo)簽：fpga asic 1.1k 0

賽靈思:構(gòu)建一個(gè)項(xiàng)目需要我們付出多少努力？

我經(jīng)常被問(wèn)及項(xiàng)目的規(guī)劃和設(shè)計(jì)所需工作量的比例。這可能是一個(gè)沒(méi)有任何意義的問(wèn)題，因?yàn)椴煌?lèi)型的項(xiàng)目有著不同的答案。NASA對(duì)此進(jìn)行了研究，利用著名的并且很...

2017-01-13 標(biāo)簽：fpga asic 727 0

Adam Taylor玩轉(zhuǎn)MicroZed系列，第79部分

By Adam Taylor 在本系列博客的前兩部分中，我們研究了帶有Zynq SoC PS(處理器系統(tǒng))的以太網(wǎng)MAC(介質(zhì)訪問(wèn)控制層)，包括深入探討...

2017-01-13 標(biāo)簽：fpga asic 979 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線(xiàn)束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線(xiàn)協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線(xiàn)。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線(xiàn)傳輸中的概念。特性阻抗是射頻傳輸線(xiàn)影響無(wú)線(xiàn)電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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