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賽靈思

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賽靈思技術(shù)

UltraFast設(shè)計的建議方法及電路板和器件規(guī)劃介紹

介紹有關(guān)電路板和器件規(guī)劃的UltraFast設(shè)計方法建議。本快速入門介紹了電路板布局建議，IO和時鐘規(guī)劃以及電源注意事項等關(guān)鍵主題。

2018-11-20 標簽：電源電路板賽靈思 3.4k 0

探討SDN/NFV的現(xiàn)實意義以及深遠影響

賽靈思杰出工程師Gordon Brebner將在本視頻與您一起探討SDN / NFV的現(xiàn)實意義以及深遠影響，還有正在推動這一大趨勢的硬件及軟件技術(shù)。

2018-11-26 標簽：賽靈思硬件軟件 3.4k 0

基于賽靈思所有可編程FPGA和SoC的DeePhi深度學(xué)習(xí)平臺介紹

DeePhi Tech是面向無人機，機器人，監(jiān)控攝像機和數(shù)據(jù)中心應(yīng)用的FPGA深度學(xué)習(xí)平臺提供商.DeePhi平臺基于賽靈思所有可編程FPGA和SoC，...

2018-11-28 標簽：fpga 賽靈思 soc 3.4k 0

如何在IP Integrator中使用自定義IP

了解如何使用Vivado在設(shè)備啟動時及其周??圍進行調(diào)試。你也會學(xué)習(xí) 使用Vivado 2014.1中引入的Trigger at Startup功...

2018-11-27 標簽：賽靈思 ip 調(diào)試 3.3k 1

Zynq UltraScale+ MPSoC為軟件移植提供穩(wěn)健可靠的平臺

在美國計算機學(xué)會雜志《美國計算機協(xié)會通訊全集》的一篇專欄中，Steve Furber 指出，32 位 ARMv7 SoC（例如 Zynq UltraSc...

2019-07-30 標簽：賽靈思 C++編譯器 3.3k 0

FPGA的系統(tǒng)設(shè)計實現(xiàn)方案

人群的監(jiān)控與監(jiān)測已經(jīng)成為當(dāng)前的一個重要領(lǐng)域。政府和安全部門都已經(jīng)開始尋求在公共場所智能監(jiān)測人群的更先進的方式，從而避免在來不及采取行動之前檢測到任何異?；顒?。

2016-02-24 標簽：傳感器 FPGA 賽靈思 3.3k 0

如何防止UltraScale+的差分功耗分析

了解如何為UltraScale +設(shè)計添加額外的安全級別。該視頻演示了如何防止差分功耗分析（DPA），以在比特流配置之上增加額外的安全性。

2018-11-23 標簽：fpga 賽靈思安全 3.3k 0

Artix-7 ARTY FPGA評估套件的演示

該視頻演示了基于Artix-7的低功耗ARTY FPGA評估套件，該套件采用-1LI Artix-7 FPGA。對于演示，該套件的工作功率不到半瓦，...

2018-11-29 標簽：fpga 賽靈思低功耗 3.3k 0

采用Kintex-7 FPGA KC705基板的Xilinx AMS評估卡演示

模擬混合信號評估卡支持兩種提供模擬信號源的方法。

2018-11-28 標簽：fpga 存儲器賽靈思 3.3k 0

視覺解決方案如何從plc加速電路中受益

在本視頻中，通過顯示具有OCR和canny邊緣檢測功能的高性能線掃描儀應(yīng)用SVDK，了解視覺解決方案如何從可編程邏輯中的加速電路中受益。

2018-11-23 標簽：plc 賽靈思掃描儀 3.3k 0

如何為UltraScale+設(shè)計增加額外的安全性

了解如何為UltraScale +設(shè)計添加額外的安全級別。該視頻演示了如何防止差分功耗分析（DPA），以在比特流配置之上增加額外的安全性。

2018-11-23 標簽：fpga 3d 賽靈思 3.3k 0

如何配置Petalinux工程來從Flash啟動Linux Kernel

新版petalinux生成的u-boot是通過boot.scr來加載linux kernel的。如果我們用petalinux工程默認配置和下面命令生成b...

2022-08-10 標簽：FlaSh 賽靈思 Linux 3.3k 0

賽靈思推出的業(yè)界異構(gòu)多核soc--Zynq UltraScale+ MPSoC

Zynq UltraScale+ MPSoC 面向廣泛的應(yīng)用領(lǐng)域而打造 , 非常適用于 5G 無線基礎(chǔ)設(shè)施、面向數(shù)據(jù)中心和有線通信的軟件定義網(wǎng)絡(luò)、新一代...

2019-07-30 標簽：賽靈思系統(tǒng)軟件生態(tài)系統(tǒng) 3.3k 0

如何利用C/C++編寫應(yīng)用程序加速內(nèi)核運行

SDAccel編譯器支持OpenCL C，C和C ++，用于定義FPGA執(zhí)行的內(nèi)核功能。了解如何利用用C / C ++編寫的現(xiàn)有函數(shù)作為FPGA上運...

2018-11-20 標簽：fpga 賽靈思 c++ 3.3k 0

采用I7雙核處理器的工業(yè)控制器的介紹

該視頻使用新的工業(yè)控制器，采用I7雙核處理器的IC 3173和Xilinx的Kintex 7 FPGA，面向高端機器視覺應(yīng)用。

2018-11-29 標簽：處理器控制器賽靈思 3.3k 0

嵌入式視覺的最新趨勢討論

Xilinx嵌入式視覺戰(zhàn)略營銷總監(jiān)Aaron Behman討論了嵌入式視覺的最新趨勢以及Xilinx如何為高性能圖像處理提供最靈活，基于標準的解決方案

2018-11-22 標簽：嵌入式賽靈思圖像處理 3.3k 0

嵌入式系統(tǒng)介紹和使用

系統(tǒng)電源架構(gòu)是一個需要縝密思考的的設(shè)計方面。許多嵌入式系統(tǒng)會要求隔離 AC/DC 或 DC/DC 轉(zhuǎn)換器來確保嵌入式系統(tǒng)的故障不會擴散。圖 2 顯示的是...

2019-08-01 標簽：嵌入式系統(tǒng)賽靈思電壓 3.3k 0

Vitis HLS工具簡介及設(shè)計流程

Vitis HLS 是一種高層次綜合工具，支持將 C、C++ 和 OpenCL 函數(shù)硬連線到器件邏輯互連結(jié)構(gòu)和 RAM/DSP 塊上。Vitis HLS...

2022-05-25 標簽：賽靈思 C語言 Vitis 3.3k 0

Plethora IIOT機器學(xué)習(xí)算法和解決方案的介紹

Plethora IIOT機器學(xué)習(xí)算法和解決方案可同時處理數(shù)萬個傳感器數(shù)據(jù)點，以產(chǎn)生智能實時反饋，如數(shù)控機床的預(yù)測性維護。

2018-11-26 標簽：賽靈思機器學(xué)習(xí)iiot 3.3k 0

UltraScale收發(fā)器功耗降低功能

2018-11-28 標簽：收發(fā)器賽靈思功耗 3.3k 0

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LitePoint為全球最具創(chuàng)新力的無線設(shè)備制造商提供無線測試解決方案和服務(wù)，幫助他們確保其產(chǎn)品能夠滿足當(dāng)今高標準的消費者需求。LitePoint是無線測試領(lǐng)域的領(lǐng)先創(chuàng)新企業(yè)，其產(chǎn)品開箱即用，可用于測試全球范圍內(nèi)最廣泛使用的無線芯片組。LitePoint與智能手機、平板電腦、個人電腦、無線接入點和芯片組的領(lǐng)先制造商合作。LitePoint也在新興互聯(lián)設(shè)備（物聯(lián)網(wǎng)）測試領(lǐng)域處于前沿。LitePoint總部位于加利福尼亞州硅谷，并在全球設(shè)有辦事處，是測試和工業(yè)應(yīng)用自動化設(shè)備領(lǐng)先供應(yīng)商泰瑞達（Teradyne）（納斯達克股票代碼：TER）的全資子公司。泰瑞達 2019 年營收為 23 億美元，其目前在全球范圍內(nèi)擁有 5，500 名員工。
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邊緣計算，是指在靠近物或數(shù)據(jù)源頭的一側(cè)，采用網(wǎng)絡(luò)、計算、存儲、應(yīng)用核心能力為一體的開放平臺，就近提供最近端服務(wù)。其應(yīng)用程序在邊緣側(cè)發(fā)起，產(chǎn)生更快的網(wǎng)絡(luò)服務(wù)響應(yīng)，滿足行業(yè)在實時業(yè)務(wù)、應(yīng)用智能、安全與隱私保護等方面的基本需求。邊緣計算處于物理實體和工業(yè)連接之間，或處于物理實體的頂端。而云端計算，仍然可以訪問邊緣計算的歷史數(shù)據(jù)。
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第五代移動通信技術(shù)（5th Generation Mobile Communication Technology，簡稱5G）是具有高速率、低時延和大連接特點的新一代寬帶移動通信技術(shù)，是實現(xiàn)人機物互聯(lián)的網(wǎng)絡(luò)基礎(chǔ)設(shè)施。

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