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Xilinx 7系列FPGA GTZ高速串行收發(fā)器性能與兼容性演示
展示7系列GTZ(高達(dá)28.05Gb / s)高速串行收發(fā)器的性能; 與Luxtera公司的不重定時(shí)光模塊進(jìn)行四路26G對(duì)接,實(shí)現(xiàn)100G應(yīng)用。
在蜂窩式無線電基礎(chǔ)架構(gòu)中實(shí)現(xiàn)軟件可編程數(shù)字預(yù)失真
蜂窩網(wǎng)絡(luò)運(yùn)營商正努力通過使用最新空中接口、采用最新傳輸頻率、提高帶寬以及增加天線數(shù)量和蜂窩基站數(shù)量的方式提高網(wǎng)絡(luò)容量,為此他們需要大量削減設(shè)備成本。此外...
通過UltraScale集成以太網(wǎng)節(jié)省功耗
該視頻演示了如何使用集成的以太網(wǎng)MAC來節(jié)省功耗,集成時(shí)間和邏輯利用率,同時(shí)提供最高的靈活性。
賽靈思Zynq UltraScale+ MPSoC 上的Xen管理程序教程
為客戶機(jī)提供設(shè)備有三種常用方法:仿真、半虛擬化和直通。對(duì)于設(shè)備仿真,當(dāng)客戶機(jī)向仿真設(shè)備的存儲(chǔ)器寫入時(shí),寫入操作會(huì)觸發(fā)陷阱。陷阱通常就是頁面錯(cuò)誤。陷阱使處...
作者:Olivier Tremois(AI 引擎工具市場營銷部門)和 Florent Werbrouck(賽靈思技術(shù)支持產(chǎn)品應(yīng)用工程師) Versal ...
Chipworks拆解基于臺(tái)積電28nm HPL工藝的賽靈思Kintex
Chipworks制程分析室的研究人員對(duì)使用臺(tái)積電28nm HPL制程工藝(基于gatelast HKMG技術(shù))制作的賽靈思Kintex-7 FPGA芯...
用于定時(shí)關(guān)閉的UltraFast Vivado設(shè)計(jì)方法
本培訓(xùn)中概述的方法將使您能夠?qū)崿F(xiàn)時(shí)序收斂的“簽核”質(zhì)量XDC約束。 無論復(fù)雜程度如何,這種方法還可以使您更快地實(shí)現(xiàn)時(shí)序收斂......
如何將IP模塊整合到System Generator for DSP中
了解如何將Vivado HLS設(shè)計(jì)作為IP模塊整合到System Generator for DSP中。 了解如何將Vivado HLS設(shè)計(jì)保存為IP...
此網(wǎng)絡(luò)研討會(huì)討論了小型蜂窩的無線回程容量,網(wǎng)絡(luò)和信號(hào)處理挑戰(zhàn)。 然后重點(diǎn)介紹技術(shù) - 特別是毫米波(E和V波段)無線電技術(shù),以及硬件和軟件。
Topic醫(yī)療開發(fā)平臺(tái)的最新進(jìn)展
Xilinx醫(yī)療產(chǎn)品營銷經(jīng)理Kamran Khan和Topic Embedded Products首席執(zhí)行官Rieny Rijnen分享了由Xilinx...
本課程將回顧高性能以太網(wǎng)解決方案所需的系統(tǒng)功能。 將審查Xilinx以太網(wǎng)IP內(nèi)核和相關(guān)設(shè)備驅(qū)動(dòng)程序,包括設(shè)備樹綁定。 還討論了與Petalinux的聯(lián)網(wǎng)。
觀看本視頻,了解和學(xué)習(xí)如何在您的下一代設(shè)計(jì)中使用賽靈思UltraScale架構(gòu)FPGA解決您的功耗問題,并提供更多的性能提升空間。
如何使用Vivado硬件管理器連接F1進(jìn)行定制邏輯設(shè)計(jì)
本視頻將向您展示為定制邏輯設(shè)計(jì)添加調(diào)試內(nèi)核的步驟。此外,它還包含一個(gè)演示,展示如何使用Vivado硬件管理器連接F1實(shí)例,如何調(diào)試在膝上型電腦/ Lin...
如何在IP Integrator中創(chuàng)建MicroBlaze設(shè)計(jì)
了解如何在IP Integrator中創(chuàng)建簡單的MicroBlaze設(shè)計(jì),并創(chuàng)建一個(gè)在KC705目標(biāo)板上運(yùn)行的簡單軟件應(yīng)用程序。
自定義的Zynq Windows Embedded Compact 7添加驅(qū)動(dòng)程序和功能
了解如何自定義Zynq Windows Embedded Compact 7(WEC7)板級(jí)支持包(BSP)以添加您自己的驅(qū)動(dòng)程序或功能。 該視頻使用...
Xilinx Virtex-6 FPGA的PCI Express技術(shù)演示
Virtex?-6 FPGA內(nèi)置支持PCIExpress?Gen2兼容接口。 本視頻介紹了在ML605評(píng)估套件上運(yùn)行的用于PCI Express技術(shù)的...
Xilinx 7系列模擬混合信號(hào)評(píng)估平臺(tái)演示
嵌入式世界2012的Xilinx 7系列模擬混合信號(hào)評(píng)估平臺(tái)演示
將DSP設(shè)計(jì)融入嵌入式系統(tǒng)的AXI4-Lite接口
了解System Generator如何提供AXI4-Lite抽象,從而可以將DSP設(shè)計(jì)融入嵌入式系統(tǒng)。 完全支持包括集成到IP目錄,接口連接自動(dòng)化和...
NoLoad面向Xilinx FPGA的存儲(chǔ)和計(jì)算加速平臺(tái)
在本演示中,Eideticom描述了NoLoad?,這是一款面向Xilinx FPGA的存儲(chǔ)和計(jì)算加速平臺(tái)。
本視頻介紹了在使用AXI Bridge for PCI Express Gen3子系統(tǒng)時(shí)創(chuàng)建使用Tandem with Field Updates流程的...
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