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標(biāo)簽 > 代碼
代碼就是程序員用開發(fā)工具所支持的語言寫出來的源文件,是一組由字符、符號或信號碼元以離散形式表示信息的明確的規(guī)則體系。
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SystemVerilog中的句柄賦值和對象復(fù)制的概念是有區(qū)別的。
一個(gè)優(yōu)秀的 Controller 層邏輯 從現(xiàn)狀看問題 改造 Controller 層邏輯 統(tǒng)一返回結(jié)構(gòu) 統(tǒng)一包裝處理 參數(shù)校驗(yàn) 自定義異常與統(tǒng)一攔截異...
2022-11-21 標(biāo)簽:Controller代碼spring 1.3k 0
自入行以來,無論是查閱資料、技術(shù)博客亦或是同事間的技術(shù)交流,都有一個(gè)共識(shí):在循環(huán)的時(shí)候,務(wù)必使用前置操作符,因?yàn)槠湫阅軆?yōu)于后置操作符,久而久之,這個(gè)就像...
使嵌入式系統(tǒng)代碼易于維護(hù)的10個(gè)技巧
在匆忙推出產(chǎn)品的過程中,程序員經(jīng)常忽略應(yīng)用程序的一個(gè)關(guān)鍵方面——代碼維護(hù)。
2022-11-17 標(biāo)簽:嵌入式系統(tǒng)代碼 781 0
一個(gè)通用的嵌入式驅(qū)動(dòng)層,基本都是這么玩的
以STM32為例,打開網(wǎng)絡(luò)上下載的例程或者是購買開發(fā)板自帶的例程,都會(huì)發(fā)現(xiàn)應(yīng)用層中會(huì)有stm32f10x.h或者stm32f10x_gpio.h,這些文...
如果我們是在Linux下開發(fā),那Makefile肯定要知道,不懂Makefile,面對較大的工程項(xiàng)目的時(shí)候就會(huì)比較麻煩,懂得利用開發(fā)工具將會(huì)大大提高我們...
GitHub是一個(gè)面向開源及私有軟件項(xiàng)目的托管平臺(tái),因?yàn)橹恢С謌it 作為唯一的版本庫格式進(jìn)行托管,故名GitHub。本文主要講解如何將本地代碼上傳至G...
用個(gè)簡單demo實(shí)現(xiàn)對全局變量的管理
在項(xiàng)目中基本都會(huì)遇到全局變量,隨便放很容易忘記變量的使用,也不方便后續(xù)的閱讀,就需要對全局變量進(jìn)行統(tǒng)一管理,下面就用個(gè)簡單demo,實(shí)現(xiàn)對全局變量的管理。
最近的工作日并不算太平,各種大大小小的case和解case,發(fā)現(xiàn)已經(jīng)有好久好久沒有靜下心來專心寫點(diǎn)東西了。不過倒還是堅(jiān)持利用業(yè)余時(shí)間學(xué)習(xí)了不少微課上的東...
為什么編譯這個(gè)BeagleBoard-xM開發(fā)板?因?yàn)槲覀兿胍趒emu上,qemu可以模擬這個(gè)開發(fā)板,且是arm的,更有學(xué)習(xí)價(jià)值。
2022-11-09 標(biāo)簽:操作系統(tǒng)開發(fā)板代碼 3k 0
本文主要介紹了 splice 的原理與實(shí)現(xiàn),splice 是 零拷貝技術(shù) 的一種實(shí)現(xiàn)。希望通過本文,能夠讓讀者對 零拷貝技術(shù) 有更深入的理解。
一種簡潔、可拓展的RTOS任務(wù)初始化設(shè)計(jì)
隨著寫代碼功力的提升,個(gè)人對于代碼的整潔、優(yōu)雅、可維護(hù)、易拓展等就有了一定的要求,雖然自己曾經(jīng)就屬于那種全局變量滿天飛,想到哪里寫到哪里的嵌入式軟件工程...
首先說說浪費(fèi)時(shí)間的問題,確實(shí),因?yàn)榭偸窃陂_頭檢查參數(shù),會(huì)浪費(fèi)CPU的時(shí)間(魚鷹一開始也非常不喜歡),但是當(dāng)你經(jīng)歷了各種難查的BUG之后,你會(huì)發(fā)現(xiàn),這點(diǎn)時(shí)...
本文收集一些使用Go開發(fā)過程中非常容易踩坑的case,所有的case都有具體的代碼示例,以及針對的代碼修復(fù)方法,以避免大家再次踩坑。通常這些坑的特點(diǎn)就是...
工欲善其事,必先利其器,因此,這篇文章給大家介紹幾種檢查代碼質(zhì)量的利器,Alibaba Java Coding Guidelines、CheckStyl...
本篇主要要介紹的就是 controller 層的處理,一個(gè)完整的后端請求由4部分組成。
2022-11-01 標(biāo)簽:Controller代碼 1.3k 0
HDLBits 是一組小型電路設(shè)計(jì)習(xí)題集,使用 Verilog/SystemVerilog 硬件描述語言 (HDL) 練習(xí)數(shù)字硬件設(shè)計(jì)~ 網(wǎng)址如下: h...
模型部署作為算法模型落地的最后一步,在人工智能產(chǎn)業(yè)化過程中是非常關(guān)鍵的步驟,而目標(biāo)檢測作為計(jì)算機(jī)視覺三大基礎(chǔ)任務(wù)之一,眾多的業(yè)務(wù)功能都要在檢測的基礎(chǔ)之上...
FPGA調(diào)試中LVDS信號線間串?dāng)_問題
在FPGA調(diào)試過程中,除了邏輯代碼本身的質(zhì)量之外,F(xiàn)PGA板子上PCB走線、接插件質(zhì)量等因素的影響也非常重要。
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