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開(kāi)放式電阻抗成像技術(shù)對(duì)測(cè)量系統(tǒng)的精度要求很高,為此研制了基于FPGA的數(shù)字相敏檢波器(DPSD)以用于電阻抗成像的數(shù)據(jù)測(cè)量。通過(guò)分析DPSD的信號(hào)采集與計(jì)算原理,給出了關(guān)鍵參數(shù)的計(jì)算,基于DDS技術(shù)的ADC時(shí)鐘設(shè)計(jì)方法。同時(shí)設(shè)計(jì)了高速多通道ADC轉(zhuǎn)換電路,低抖動(dòng)性能的ADC時(shí)鐘電路、FPGA實(shí)現(xiàn)實(shí)時(shí)數(shù)字相敏檢波的計(jì)算方法,提高了系統(tǒng)的信噪比。經(jīng)實(shí)驗(yàn)測(cè)試表明,在1KHz~1MHz正弦信號(hào)注入頻率的條件下,系統(tǒng)的信噪比最高可達(dá)104dB,精度高,穩(wěn)定度好。
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