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      ZigBee網(wǎng)絡(luò)節(jié)點(diǎn)基帶處理器的設(shè)計(jì)與實(shí)現(xiàn)

      2009-04-17 | rar | 149 | 次下載 | 5積分

      資料介紹

      設(shè)計(jì)一款新型符合ZigBee協(xié)議的無線傳感器網(wǎng)絡(luò)節(jié)點(diǎn)基帶處理器。提出一種O-QPSK非相干解調(diào)的同步相關(guān)解碼方式，解決了解調(diào)電路的結(jié)構(gòu)冗余問題，降低了數(shù)字接收機(jī)的信噪比。設(shè)計(jì)收發(fā)控制器完成發(fā)送與接收流程的管理，通過模式切換和軟件平臺(tái)的優(yōu)化降低了整個(gè)節(jié)點(diǎn)芯片的工作功耗和面積。通過Altera Stratix S80 FPGA平臺(tái)進(jìn)行測(cè)試驗(yàn)證，結(jié)果符合設(shè)計(jì)要求。
      關(guān)鍵詞：ZigBee協(xié)議；無線傳感器網(wǎng)絡(luò)；基帶處理器
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