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鎖相環(huán)（PLL）是集成電路中非常重要的模塊，常常用來(lái)實(shí)現(xiàn)時(shí)鐘倍頻，時(shí)鐘綜合，抖動(dòng)衰減，數(shù)據(jù)時(shí)鐘恢復(fù)等功能。PLL是一個(gè)非線性的離散系統(tǒng)，很難準(zhǔn)確刻畫(huà)。在一定的條件下——開(kāi)環(huán)帶寬小于參考頻率的1/10——可以把它作為一個(gè)線性系統(tǒng)來(lái)近似處理。在行為級(jí)，或稱系統(tǒng)級(jí)，工程師可以用一些輔助工具如Matlab或Verilog-A，來(lái)實(shí)現(xiàn)PLL的模型。在將行為級(jí)的模型細(xì)化為晶體管級(jí)的電路時(shí)，工程師們一般是把PLL的各個(gè)子模塊分別設(shè)計(jì)和刻畫(huà)，再用線性模型把它們組合在一起，得到各種環(huán)路參數(shù)。其中的原因有兩個(gè)：一是線性模型的準(zhǔn)確性很高，能夠滿足工程的需要；二是整個(gè)PLL一起仿真時(shí)，對(duì)硬件和軟件的要求都很高：?jiǎn)螁我粋€(gè)瞬態(tài)仿真，在滿足精度和功能兩個(gè)條件下，就要花費(fèi)數(shù)小時(shí)，甚至數(shù)天，更別說(shuō)要仿真環(huán)路參數(shù)了。這樣的代價(jià)在工程開(kāi)發(fā)中是不可接受的。
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