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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>數(shù)字信號(hào)處理論文>基于ME算法的RS譯碼器VLSI高速實(shí)現(xiàn)方法

      基于ME算法的RS譯碼器VLSI高速實(shí)現(xiàn)方法

      2011-12-15 | pdf | 405 KB | 次下載 | 免費(fèi)

      資料介紹

      利用ME算法實(shí)現(xiàn)結(jié)構(gòu)設(shè)計(jì)了一種低資源占用率、低成本的高速RS譯碼器。邏輯綜合及仿真結(jié)果表明,基于Altera公司CycloneII系列FPGA的RS(255,239)譯碼器,工作時(shí)鐘達(dá)210 MHz,可滿足數(shù)據(jù)速率1.68 Gb·s-1的編譯碼要求。

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