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針對(duì)SDRAM 控制器讀寫數(shù)據(jù)塊訪問延時(shí)長(zhǎng)、速度慢的問題，提出時(shí)間隱藏技術(shù)，將其應(yīng)用于SDRAM 控制器的設(shè)計(jì)，采用FPGA實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明，時(shí)間隱藏技術(shù)有效縮短了數(shù)據(jù)塊讀寫訪問延時(shí)，提高了讀寫速度，寫4×4 數(shù)據(jù)塊可節(jié)約時(shí)間52%，讀8×8 數(shù)據(jù)塊可節(jié)約時(shí)間44%。
關(guān)鍵詞：時(shí)間隱藏；數(shù)據(jù)塊；SDRAM 控制器
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