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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>Vitis HLS：使用任務(wù)級(jí)并行性的高性能設(shè)計(jì)

      Vitis HLS：使用任務(wù)級(jí)并行性的高性能設(shè)計(jì)

      2023-09-13 | pdf | 0.23 MB | 次下載 | 免費(fèi)

      資料介紹

      Vitis™ HLS 利用 AMD FPGA 提供的獨(dú)特優(yōu)勢(shì)和特性，為高性能設(shè)計(jì)優(yōu)化 C 代碼.人工智能、無線通信和圖像處理等領(lǐng)域使用的算法越來越復(fù)雜，這給高效的硬件實(shí)施帶來了挑戰(zhàn)。AMD Vitis™ 高級(jí)綜合 （HLS） 通過將 C/C++ 代碼合成為 AMD FPGA 和自適應(yīng)片上系統(tǒng) （SoC） 的 RTL 代碼，加速 IP 創(chuàng)建，從而應(yīng)對(duì)這些挑戰(zhàn)。
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