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      電子發(fā)燒友網(wǎng)>電子資料下載>嵌入式開發(fā)>低電壓、低功耗模擬電路設(shè)計(jì)方案詳解

      低電壓、低功耗模擬電路設(shè)計(jì)方案詳解

      2015-06-27 | pdf | 217KB | 次下載 | 免費(fèi)

      資料介紹

      隨著亞微米、深亞微米技術(shù)和系統(tǒng)芯片（SOC）技術(shù)的日益成熟，功耗已經(jīng)成為模擬電路設(shè)計(jì)中首要考慮的問題， 低電壓低功耗集成電路設(shè)計(jì)漸漸成為主流。 因?yàn)?MOS 晶體管的襯底或者與源極相連，或者連接到 VDD 或 VSS，所以經(jīng)常被用作一個(gè)三端設(shè)備。
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