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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>Xilinx FPGA的SerDes接口詳細說明

      Xilinx FPGA的SerDes接口詳細說明

      2020-12-30 | rar | 0.21 MB | 次下載 | 免費

      資料介紹

      　　因為攝像頭輸出的LVDS信號速率會達到600Mbps，我們將不能夠通過FPGA的I/O接口直接去讀取這么高速率的信號。因此，需要使用Xilinx FPGA內(nèi)的SerDes去實現(xiàn)高速數(shù)據(jù)的串并轉(zhuǎn)換。

      　　熊貓君的文章“Zynq高速串行CMOS接口的設(shè)計與實現(xiàn)”，都已經(jīng)說清楚了，大神~~

      　　參考文檔ug953，ug471，我們?yōu)榱瞬东@OV7251攝像頭LVDS的數(shù)據(jù)信號，將會使用的以下資源：

      　　IDELAYCTRL

      　　IDELAYE2

      　　ISERDESE2

      　　ODELAYE2 （用于模擬LVDS輸出信號）

      　　OSERDESE2 （用于模擬LVDS輸出信號）

      　　MMCME2_ADV

      　　BUFG， BUFR， BUFIO， IBUFG， IBUFDS， OBUFDS

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