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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>Altera FPGA教程之讓你七天學(xué)會Altera FPGA的時(shí)序分析

      Altera FPGA教程之讓你七天學(xué)會Altera FPGA的時(shí)序分析

      2018-09-13 | pdf | 16.39 MB | 次下載 | 免費(fèi)

      資料介紹

      　　網(wǎng)上關(guān)于 Altera 的教程很多，可謂浩如煙海。大體來說有兩類：一是，step by step 的指導(dǎo)如何操作 Quartus 軟件，這類方法的優(yōu)點(diǎn)是上手快，但卻有知其然不知其所以然之惑；二是，從一個(gè)很高的起點(diǎn)分析一些具體問題，優(yōu)點(diǎn)是有深度，但也把大部分初學(xué)者拒之門外，不知路在何方。

      　　本系列教程的宗旨是在力求全面介紹 Altera 及其 QuartusII 軟件原理的基礎(chǔ)上，對何如使用 Altera FPGA 進(jìn)行基礎(chǔ)設(shè)計(jì)、時(shí)序分析、驗(yàn)證、優(yōu)化四大方面進(jìn)行講解。

      　　本篇為時(shí)序篇，推薦用兩天時(shí)間掌握。其余的，基礎(chǔ)篇需一天，驗(yàn)證、優(yōu)化各需兩天，一共七天。本教程大部分內(nèi)容參考翻譯altera官方handbook和對應(yīng)的paper等資料，1.2、 1.4、1.6、2.1 系熱心網(wǎng)友 riple 所創(chuàng)，筆者基本原文引用，只為閱讀流暢性和更易理解做了少許改動，如造成原作者的不適，可聯(lián)系筆者刪除之。后續(xù)教程視讀者反映情況進(jìn)行適當(dāng)調(diào)整和發(fā)布。

      　　1. 時(shí)序分析基本概念

      　　靜態(tài)時(shí)序分析（Static Timing Analysis---STA）的前提是同步邏輯設(shè)計(jì)：通過路徑計(jì)算延遲的總和，并比較相對于預(yù)定義時(shí)鐘的延遲。靜態(tài)時(shí)序分析僅關(guān)注時(shí)序間的相對關(guān)系而不是評估邏輯功能。

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