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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>csrGen: Automated_CSRs_for_ASIC/FPGA_Processor_Interfaces

      csrGen: Automated_CSRs_for_ASIC/FPGA_Processor_Interfaces

      2016-02-24 | pdf | 66KB | 次下載 | 1積分

      資料介紹

      csrGen is a tool to automatically produce synthesizable verilog RTL code for the registers that make up the memory map of a processor interface from a simple template that lists and describes the registers. Using a tool for registers speeds ASIC or FPGA development, avoids common errors, and can also aid documentation, verification, and firmware development.
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