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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>一種復(fù)雜芯片的FPGA驗(yàn)證

      一種復(fù)雜芯片的FPGA驗(yàn)證

      2011-09-27 | pdf | 324 KB | 次下載 | 免費(fèi)

      資料介紹

      介紹了模塊層次構(gòu)造算法和改進(jìn)的K-L算法對設(shè)計(jì)進(jìn)行劃分，有效地減少了FPGA間的互連信號數(shù)。通過引腳復(fù)用(CPM)的方，解決了多塊FPGA間互連過多而引起的引腳不足間題。另一方面，F(xiàn)PGA的運(yùn)行頻率遠(yuǎn)遠(yuǎn)低于實(shí)際芯片的工作頻率，通過在接口設(shè)置延遲寄存器和修改系統(tǒng)軟件可以準(zhǔn)確評估實(shí)際流片芯片的性能，實(shí)驗(yàn)的誤差在2%以內(nèi)。

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