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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>設(shè)計性能物理綜合與優(yōu)化

      設(shè)計性能物理綜合與優(yōu)化

      2009-11-27 | rar | 225 | 次下載 | 2積分

      資料介紹

      曾經(jīng)只能使用 ASIC 來實現(xiàn)的設(shè)計現(xiàn)在可以在可編程器件中實現(xiàn)了。最新的 90 nm Virtex-4 器件提供了超過200,000 個邏輯單元、6 MB 的塊 RAM 和接近 100 個 DSP 塊。創(chuàng)建能夠有效利用這些器件中的可用資源并滿足性能要求的設(shè)計是極具挑戰(zhàn)性的工作。幸運(yùn)的是，今天的 EDA 軟件工具已經(jīng)發(fā)展到能夠應(yīng)對這些挑戰(zhàn)了。
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