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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于Altera系列器件的邏輯鎖定方法學(xué)在FPGA設(shè)計(jì)中的應(yīng)

      基于Altera系列器件的邏輯鎖定方法學(xué)在FPGA設(shè)計(jì)中的應(yīng)

      2009-09-03 | rar | 710 | 次下載 | 3積分

      資料介紹

      Altera 公司出品系列器件所用設(shè)計(jì)軟件――Quartus?II，提供了一種其獨(dú)有的優(yōu)化方法：邏輯鎖定（LogicLock）。本文介紹了一種在實(shí)際工程中應(yīng)用邏輯鎖定的方法，并加以仿真驗(yàn)證。

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