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      電子發(fā)燒友網(wǎng)>電子資料下載>傳感與控制>基于PCIe的多路傳輸系統(tǒng)的DMA控制器設(shè)計(jì)

      基于PCIe的多路傳輸系統(tǒng)的DMA控制器設(shè)計(jì)

      2017-12-05 | rar | 0.78 MB | 次下載 | 3積分

      資料介紹

      　　為了避免PCIe傳輸過程中PIO寫延時(shí)、主機(jī)與嵌入式處理系統(tǒng)交互次數(shù)過多等問題對(duì)于傳輸帶寬的影響，設(shè)計(jì)了一種基于命令緩沖機(jī)制的直接存儲(chǔ)訪問（ DMA）控制器以提高傳輸帶寬利用率。采用FPGA端內(nèi)部設(shè)置命令緩沖區(qū)的方式，使得DMA控制器可以緩存PC端的數(shù)據(jù)傳輸請(qǐng)求，F(xiàn)PGA根據(jù)自身需求動(dòng)態(tài)地訪問PC端存儲(chǔ)空間，增強(qiáng)了傳輸靈活性；同時(shí)，提出一種動(dòng)態(tài)拼接的DMA調(diào)度方法，通過合并相鄰存儲(chǔ)區(qū)訪問請(qǐng)求的方式，進(jìn)一步減少主機(jī)與硬件的交互次數(shù)和中斷產(chǎn)生次數(shù)。系統(tǒng)傳輸速率測(cè)試實(shí)驗(yàn)中，DMA寫最高速率可達(dá)1 631 MB/s，DMA讀最高速率可達(dá)1582 MB/s，帶寬最大值可達(dá)PCIe總線理論帶寬值的85. 4qo；與傳統(tǒng)PIO方式的DMA傳輸方法相比，DMA讀帶寬提升58%，DMA寫帶寬提升36%。實(shí)驗(yàn)結(jié)果表明，本設(shè)計(jì)能夠有效提升DMA傳輸效率，明顯優(yōu)于PIO方式。

      基于PCIe的多路傳輸系統(tǒng)的DMA控制器設(shè)計(jì)

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