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賽靈思最新SmartLynq+模塊,讓秒級迭代成為現(xiàn)實

FPGA之家 ? 來源:賽靈思 ? 作者:賽靈思 ? 2021-03-12 14:22 ? 次閱讀
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在您最狂野的想象里是否夢想過,設計迭代僅需幾秒鐘即可完成?賽靈思最新力作SmartLynq+模塊,讓秒級迭代成為現(xiàn)實!

隨著異構計算時代的到來,各種應用專用的處理引擎將性能和效率帶入更高境界,而調(diào)試和跟蹤工具也必須隨之不斷發(fā)展,以跟上器件平臺的發(fā)展速度。

如今,賽靈思編程、調(diào)試和跟蹤模塊產(chǎn)品組合再添一員悍將——SmartLynq+ 模塊,其構建旨在滿足 Versal平臺開發(fā)者的高速調(diào)試和跟蹤需求。

與此前的賽靈思調(diào)試產(chǎn)品相比,SmartLynq+模塊通過 HSDP 可將 Linux下載時間加快高達28倍,將數(shù)據(jù)捕獲速度提高100倍。更快的迭代和重復下載既提高了開發(fā)效率,也縮短了設計周期。這樣一來,開發(fā)者無需花費寶貴的時間進行調(diào)試,而可以專注于啟動基于 Versal 的解決方案。

借助串行、并行跟蹤以及集成的軟件可編程調(diào)試器,SmartLynq+ 模塊是用于包括 Versal ACAP 等各種平臺的終極高速調(diào)試和跟蹤模塊。其主要特性和優(yōu)勢包括:

超快的下載速度,最大限度提高開發(fā)生產(chǎn)力,實現(xiàn)更快迭代

更高可見性的高速跟蹤數(shù)據(jù),提供高達14GB的業(yè)界最大跟蹤內(nèi)存捕捉執(zhí)行歷史記錄

可全面查看的異構架構和對Versal架構的深度調(diào)試,包括AI引擎

所有子系統(tǒng)的內(nèi)聚及時間相關調(diào)試

靈活、智能的調(diào)試平臺,可以使用軟件可定制的內(nèi)建調(diào)試器為遠程訪問和共享實現(xiàn)智能濾波

智能引擎包括 SIMD VLIW AI 引擎和 DSP 引擎,前者用于自適應推斷和高級信號處理計算,后者則用于定點、浮點和復雜 MAC 操作

具有統(tǒng)一視圖的可共享調(diào)試平臺,可用于遠程多用戶環(huán)境

SmartLynq+提供了眾多突破性能和智能功能,是市場上最智能、最靈活的調(diào)試產(chǎn)品。

SmartLynq + 模塊主要功能及接口

SmartLynq +模塊主要功能和接口包括:

主機側(cè) USB 3.0連接器,千兆以太網(wǎng)連接到網(wǎng)絡并啟用遠程訪問

高速調(diào)試端口(HSDP),可實現(xiàn)更快的編程,調(diào)試和高速串行跟蹤

JTAG(PC4接頭),提供高達100MHz的速度

8位通用I/O(GPIO)端口,用于目標板上的各種基本輸入/輸出操作

用于并行跟蹤的Mictor- 38連接器(保留以備將來使用)

SmartLynq+ 模塊隨附的附件包括電源、USB 和以太網(wǎng)電纜、micro SD 卡、JTAG 和 GPIO 飛線電纜。用戶需下載最新 SD 卡映像,按必要步驟設置模塊,然后使用 Versal ACAP 進行開發(fā)。此外還有嵌入式設計教程(EDT)幫助用戶入門。

用戶還可以將 SmartLynq+ 模塊與現(xiàn)已發(fā)貨的 Versal AI Core 系列VCK190 評估套件和Versal Prime 系列VMK180 評估套件結合使用,切身體驗 HSDP 的強大功能!

原文標題:SmartLynq+ 模塊發(fā)布,秒級迭代“不是夢”

文章出處:【微信公眾號:FPGA之家】歡迎添加關注!文章轉(zhuǎn)載請注明出處。

責任編輯:haq

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